Recruitment background

Design Verification Engineer

텍사스인스트루먼트코리아|2026. 10. 14. 게시|
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공고 요약

경력10년 이상
채용 유형정규직
학력학사
지역해외
마감일마감
출처직행

담당업무

  • 모듈 및 시스템 수준의 테스트 전략, 성능 검증, 검증 계획, 테스트벤치, 기능 모델 및 테스트 케이스 설계·개발

  • C/UVM 테스트벤치를 활용한 블록부터 전체 시스템·SoC 수준의 디지털 로직 검증 방법론 개선

  • 커버리지 기반 제약 랜덤 자극을 이용한 시뮬레이션 테스트 작성·실행·개선 및 디버깅

  • 기능 커버리지 정의·구현 및 커버리지 달성 관리

  • 복잡한 설계의 문제 원인 분석 및 검증 구성요소 재사용을 위한 협업

  • 에뮬레이션 환경의 SoC 검증과 실리콘 검증·특성화·디버깅

  • 외부 공급업체와 납품 일정 및 품질 관리 협업

  • IP 검증 계획 및 테스트 지원, 기능 디버깅, 실리콘 초기 구동, 테스트 프로그램 개발, 고객 대응 및 실리콘·응용 디버깅 지원

필수 역량

  • 데이터 이동, SoC 통합 개념 및 AMBA 버스 프로토콜(AXI, CHI, AHB, APB 등) 전문성

  • DMA, 캐시, ARM CPU 코어, DDR 관련 경험 또는 이해

  • Verilog 활용 능력

  • NCsim 등 시뮬레이션 도구, 코드 커버리지 및 디버그 도구 경험

  • 원활한 의사소통 능력

우대사항

  • 디지털 기능 및 디지털 설계 방법론 이해

  • 기존 설계의 검증 계획 수립 및 문서가 제한적인 레거시 설계 지원 능력

  • 검증 환경 이해와 기능 디버깅 참여 경험

  • SystemVerilog 및 VHDL 경험

  • AXI, CHI, AHB, APB, OCP 등 버스 프로토콜에 대한 심층 지식

  • Tcl, Perl, Python 등 스크립팅 언어 활용 능력

  • ATE 및 벤치 특성화 환경을 이용한 실리콘 디버그 경험

  • 여러 시간대의 팀과 협업하며 결과를 주도하고 일정과 산출물을 관리하는 능력

  • 체계적인 문제 해결, 분석 및 시간 관리 역량

보상 및 복리후생

경쟁력 있는 급여 및 복리후생 제공, 국가별 복리후생 안내

지원방법

해당 채용 requisition으로 지원

마감기한

2026년 10월 20일 14:00까지

공고 원문

텍사스인스트루먼트코리아 Design Verification Engineer 채용공고

이런 공고는 어때요?

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#UVM검증  #Verilog  #PCIe
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Principal Silicon Design Methodology Engineer
#반도체  #RTL설계  #IP검증
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#반도체  #UVM검증  #생성형AI
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Sr. Design Verification Engineer - Fabric Interconnect Performance
#반도체  #UVM검증  #성능검증
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Design Verification Engineer
#반도체  #프리실리콘  #UVM
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Design Verification Engineer
#반도체  #UVM테스트  #RTL검증
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#반도체  #UVM검증  #생성형AI
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#반도체  #아날로그검증  #전력관리
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3년 이상 · 정규직 · 해외

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#AI실리콘  #검증테스트  #시뮬레이션
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#반도체  #검증환경  #AI데이터센터
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#네트워킹  #ASIC검증  #UVM
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[10월] 월간 hy-way(경력) - DRAM/NAND개발(HBM Digital Design (검증))
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Senior / Staff Engineer - Mixed Signal Verification
#반도체  #RTL검증  #UVM
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#반도체  #회로모델  #검증테스트
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Design Verification Engineer
#반도체  #UVM  #정규직
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Design Verification Engineer
#반도체  #UVM테스트  #AMS검증
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IP Verification Lead with PCIe
#반도체  #PCIe  #UVM
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Formal Verification Engineer II
#반도체  #포멀검증  #SVA
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