ASIC frontend engineer
공고 요약
담당업무
개발 SOC에 적합한 Logic Level 구현 및 검증
고성능 CPU·고속 Interface IP의 Complex Clock 구조에 따른 Timing Methodology 구현
UPF 구현 및 Low Power Specific SOC 개발
Design Flow 및 Signoff Methodology 개발·구현
자격요건
해당 전공 분야 대졸 이상
S·H 반도체회사, Fabless, Design House 등 관련 회사 경력
SOC 관련 Full Chip Timing 경험
SCAN, ATPG, Memory BIST 경험
Design Compiler, DCG, PrimeTime, Formality, VCLP, GCA, Spyglass-LDRC 등 관련 툴 경험
우대사항
High Speed IP DDR5·PCIe·NAND PHY Implementation 경험
High Speed IP Test Scheme 구현 경험
FinFET 경험
보상
적합한 후보 최고대우
접수방법
이메일 접수
이력서 및 경력소개서 제출
경력 중심으로 작성
응시분야 및 희망연봉 기재
마감기한
2026년 9월 19일 23:59까지
공고 원문
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