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[사피엔반도체] RTL Design Verification 경력직 연구원 채용

사피엔반도체|2026. 8. 27. 게시|
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공고 요약

경력5년 이상
채용 유형정규직
학력무관
지역경기
마감일채용시마감
출처링커리어

담당업무

  • UVM 환경 Setup 및 Verification 업무

  • Verilog 및 SystemVerilog를 이용한 검증 환경 구성과 프로그래밍

  • C 및 Python을 이용한 검증 Component 설계

  • RTL IP 설계 및 Verification

자격요건

  • RTL 설계 및 Verification 경력

  • 전기전자·반도체공학 등 관련 전공

  • 원활한 대인관계 및 커뮤니케이션 능력

우대사항

  • 관련 전공 석사 이상

  • 영어회화 가능

  • RTL Verification 관련 기업 출신 경력

마감기한

채용시 마감

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공고 원문

사피엔반도체 [사피엔반도체] RTL Design Verification 경력직 연구원 채용 채용공고
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